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AMD ROCm 推出 Loom 0.1 编译器,实现 CPU/GPU/NPU 统一编译

2026-10-30 12:11:56 来源:网易 编辑:卞凝钧 

AMD 正式发布 ROCm HRX Loom 0.1 编译器工具链,这款全新编译组件最大亮点就是实现 CPU、GPU、NPU 三类硬件的统一编译,大幅简化异构算力开发流程,同时把内核编译耗时压缩到 2 毫秒以内,彻底解决传统编译方案运行时开销大、多硬件适配繁琐的痛点,成为 ROCm 生态重要的底层技术升级。以往开发异构程序,CPU、GPU、NPU 需要分开搭建三套编译链路,维护多套代码与编译脚本,开发与运维成本居高不下。Loom 0.1 整合统一中间表示层,只用一套代码就能面向 AMD 全系列算力硬件生成二进制程序,同时采用原生异步编译架构,不再依赖 LLVM 子进程调用,编译延迟大幅降低,非常适合 AI 推理、HPC 高性能计算这类低延迟场景。开发者只需要搭建一套 Loom 编译环境,就能同时完成 x86 CPU、AMD GPU、NPU 内核的编译打包,不用反复切换工具链,代码复用率显著提升。配合对 MFMA、WMMA 矩阵指令与 F4/F6/F8 微量化数据格式的原生支持,整套工具链可以无缝承接大模型训练与推理任务,进一步完善 ROCm 异构算力软件底座。

一、Loom 0.1 核心技术能力清单

  1. 多硬件统一编译能力 单套编译链路同时支持 AMD CPU、GPU、NPU 三类目标硬件,支持生成 AMDGPU 原生 HSACO 代码与 SPIR-V 跨平台二进制,x86 CPU 编译能力已经进入完善阶段。
  2. 超低延迟异步编译 摒弃传统 HIP 依赖 LLVM 子进程的模式,原生异步编译架构,设备内核编译耗时低于 2 毫秒,消除运行时即时编译带来的性能损耗。
  3. AI 算力指令原生适配 原生支持 MFMA、WMMA 矩阵运算指令,兼容 F4、F6、F8 低精度微量化数据类型,适配大模型量化推理与矩阵计算场景。
  4. 轻量化部署与安装 整体打包为 hrx-loom 软件包,开发者可以直接通过 pip 一键完成安装,自带命令行工具与 Python 开发 API,上手门槛更低。
  5. 深度融入 ROCm HRX 体系 作为 ROCm HRX 运行时的核心编译器组件,替代传统 HIP 编译栈,为超低延迟异构计算提供完整底层支撑。

二、传统编译方案与 Loom 0.1 对比表

表格

项目传统 HIP+LLVM 编译方案Loom 0.1 统一编译方案
编译目标仅支持 GPU,CPU 与 NPU 需要独立工具链CPU+GPU+NPU 三合一,单套工具链全覆盖
编译架构调用 LLVM 子进程,进程开销大原生异步编译,无额外进程开销
单次内核编译耗时十几毫秒到数十毫秒小于 2 毫秒,几乎无延迟
代码维护多硬件多套源码,维护成本高一套源码编译到多硬件,代码高度复用
量化指令支持需要额外手动适配微量化格式原生支持 F4/F6/F8 低精度量化指令

三、Loom 0.1 标准编译部署步骤

第一步:完成 ROCm HRX 基础环境部署,匹配对应版本的驱动与运行时库;

第二步:使用 pip 命令在线安装 hrx-loom 编译器套件,一键补齐编译依赖;

第三步:编写统一内核代码,不需要针对 CPU、GPU、NPU 分别编写分支代码;

第四步:调用 Loom 编译命令,选择目标硬件类型,一键生成对应硬件的二进制程序;

第五步:将编译好的内核加载到 HRX 运行时,直接在 CPU、GPU 或 NPU 硬件上执行运算。

四、落地应用场景

  1. 大模型异构推理:单套代码同时部署在 CPU、GPU、NPU 硬件上,实现算力负载均衡,降低多硬件适配工作量;
  2. HPC 高性能科学计算:低延迟编译大幅缩短任务启动耗时,异步编译模式适配大规模并行计算任务;
  3. 端侧 + 数据中心混合部署:统一编译链路打通云端 NPU、数据中心 GPU、服务器 CPU,实现代码跨硬件无缝迁移;
  4. AI 智能体任务调度:配合 ROCm Hyperloom 优化工具,自动完成多硬件内核编译与性能调优。

【相关 FAQ】

问题 1:Loom 0.1 实现 CPU/GPU/NPU 统一编译,能减少多少异构开发工作量?

回答 1:Loom 0.1 实现 CPU/GPU/NPU 统一编译,开发者只需要维护一套源代码,不用为三类硬件分别搭建三套独立编译工具链,省去大量分支代码与多套编译脚本的维护工作,同时编译链路统一,大幅降低多硬件适配的调试成本,整体异构开发效率得到显著提升。

问题 2:Loom 0.1 把内核编译压缩到 2 毫秒以内,相比传统 LLVM 编译优势体现在哪里?

回答 2:传统 HIP 编译会调用独立 LLVM 子进程,产生进程创建与调度开销,单次编译耗时普遍在十几毫秒;Loom 0.1 采用原生异步编译基底,不额外拉起子进程,直接生成 AMDGPU 原生代码对象,把编译耗时控制在 2 毫秒以内,消除运行时即时编译带来的延迟,更适合低延迟 AI 推理场景。

问题 3:Loom 0.1 编译器是否可以直接对接 ROCm 大模型推理框架?

回答 3:Loom 0.1 是 ROCm HRX 系统的核心编译组件,原生支持 MFMA 矩阵指令与低精度量化格式,能够直接对接大模型推理任务,配合 HRX 运行时完成 CPU/GPU/NPU 多硬件内核编译与调度,适配 vLLM 等主流推理框架,可直接用于异构算力模型部署。

【数据来源】

[2026-10-30](AMD ROCm Loom 0.1 发布:CPU/GPU/NPU 统一编译)快科技(网易号)

[2026-10-30](ROCm HRX Loom SDK v0.1 技术详解)AMD 官方开发者社区

[2026-10-30](Loom 异步编译架构性能测试)ROCm GitHub 项目文档

[2026-10-30](hrx-loom 软件包安装说明)PyPI 软件仓库

免责声明:本文仅客观介绍 AMD ROCm Loom 0.1 编译器的发布信息、技术参数与功能特性;编译性能、硬件适配效果会受系统版本、驱动型号、代码写法影响,实际性能以开发者本地实测结果为准;本文内容仅作为技术科普,不构成软硬件采购与开发选型的最终依据。

 
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